一、RS锁存器分析1.1由两个异或门组成的RS锁存器，如下图所示
SD、RD分别作为锁存器的输入端，q、q作为锁存器输出端。
这里，可以将输入端子SD设定为SET，即设定； 将RD设为RESET，即复位。 这是RS锁存器名称为RS锁存器的原因。
真值表输入输出SD
RDQ'Q00XX011010011100
通过真值表我们可以很容易地发现
在锁存输入端子SD、RD同时为0情况下，q '、q输出为x； SD=0、RD=1输出端Q=0，即复位有效的情况下； SD=1、RD=0输出端Q=1，即置位有效的情况下； SD=1，RD=1是Q=0，但实际上不存在Q`=0，(实际上q不等于q ' )。 另外，输入端子SD和RD同时为1也是矛盾的。 因为不能复位一个电路并同时设置。 接下来，它将帮助您了解RS锁存器是如何保存的状态图。
如上图所示，灰色圆内的0，1分别表示q的值。
如果Q=0，则只有在SD=1、RD=0时，q值才会更改为1，否则不会更改。 也就是说，会被闩锁。 如果Q=1，则只有在SD=0、RD=1时，q值才会更改为0，否则不会更改。 也就是说，会被锁定。 1.2与非门RS锁存器
如上图所示，RD '和SD '是电路的输入端子，q '和q是电路的输出端子。 也可以从电路中得到真值表。
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从真值表可以看出，由NAND门构成的RS锁存器的逻辑功能与NAND门一致，但由NAND门构成的电路的输入为负逻辑。 即，输入“0”“有效”、“1”“无效”。
1.3 D闩锁
如图所示，c、d是电路的输入端，q’和q是电路的输出端，可以同样获得真值表。
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用真值表总结如下
在C=0情况下，无论d取什么样的值，中间信号rd '和SD '的值都是确定的，q的值是未知的
当C=1，Q=D时
由此，可以将输入端子c作为电路的“使能”端子。 用电路的波形图进行说明。
在T0-T1和T4-T6的时间段C=0，q值保持二次状态被锁存。
实际的d锁存器中还存在特殊情况——“翻转”。
如上图所示，当C=1时，输入端d多次反转，q也随之多次反转，因此q的多次反转称为翻转，这种情况是不利的。 在避免实用化的同时，也因此而产生了触发器。
二. d触发器2.1 D触发器
如上图所示，用右侧图中的符号替换左侧图中的电路。
如上图所示，对于由2个d锁存器构成主从d触发器，d、CLK是电路的输入，q '、q是输出。
上图为d触发器的波形图，此时，可以看出输入端d、输出端Q2在CLK的上升沿触发了变化。 这也是触发器和锁存器的最大区别。 同时，这也是定时电路的雏形。
三.寄存器
如上图所示，由四个d触发器构成的4位宽寄存器。 (通过时钟端子clk的驱动，从输入端子D0-D3输入的数据被寄存器到输出端子Q0-Q3 )。
四.移位寄存器
如上所述，在具有4个d触发器的移位寄存器中，数据输入端d通过时钟输入端clk的驱动，并且在每一个时钟的基础上顺序向右移位。